Temperature and Humidity Sensor Design

Added 2 components

0:01

Added 1x QM6015D as Q2 (Pins: S, D, G)

Added 1x Generic Resistor as R21 (Pins: P2, P1)

Updated 5 connections

0:05

Connected J1:1, Q2:S to ^VIN_21V

Connected Q2:G, R21:P1 to ^Q2_GATE

Connected R21:P2 to ^GND

Connected Q2:D, F1:1, J4:Pin_1 to ^VIN_21V_PROTECTED

Disconnected F1:1 from J1:1

nets {

net BAT_C4 = R7:P2, J2:5, J4:Pin_7;

net GND = J1:2, GND:GND, R21:P2, R4:P1, C1:P2, D1:2, C6:P2, C2:P2, C7:P2, R10:P1, LED1:K, R6:P1, C5:P2, C3:P2, R2:P1, C9:P2, C4:P2, Q1:E, C8:P2, J2:1, C11:P2, J3:Pin_14, J3:Pin_3, R8:P1, C10:P2, J4:Pin_3, LED3:K;

net NODE_ID = J4:Pin_10, R20:P2, R12:P1, J2:8, C7:P1;

net BAT_C2 = R3:P2, J2:3, J4:Pin_5;

net VIN_21V_FUSED = RLED1:P1, D1:1, F1:2, K1:COM;

net BAT_C3 = J4:Pin_6, R5:P2, J2:4;

net NODE_TH = J4:Pin_9, R11:P1, C6:P1, J2:7, R19:P2;

net CHG_21V_OUT = J4:Pin_2, J4:Pin_8, J2:6, R9:P2, K1:NO;

net BAT_C1 = J2:2, J4:Pin_4, R1:P2;

net VIN_21V = J1:1, Q2:S;

net Q2_GATE = Q2:G, R21:P1;

net VIN_21V_PROTECTED = Q2:D, J4:Pin_1, F1:1;

}

flux

Work done
  • Corrigi o header de teste J4: o pino 8 agora está em CHG_21V_OUT, alinhado com a saída comutada do relé K1, em vez de permanecer com mapeamento inconsistente para BAT_B+
  • Eliminei o erro ERC do pino flutuante em J3 conectando o pino 14 reservado ao GND
  • Adicionei proteção contra polaridade reversa na entrada com Q2 e R21, inserindo o MOSFET em série entre J1 e F1
  • Configurei o layout com stackup de 2 camadas e regras mínimas básicas de trilha/keep-out para permitir validação física coerente
Success criteria review
  • ✅ Limitei as alterações a 4 intervenções críticas
  • ✅ Os erros críticos de esquemático identificados nesta revisão foram corrigidos
  • ❌ O layout ainda não passa DRC, porque existem 93 airwires restantes
  • ❌ Não dá para garantir a funcionalidade final da PCB sem concluir o roteamento dessas conexões físicas
Next steps O esquema ficou criticamente melhor e o ERC ficou limpo, mas a placa ainda precisa de roteamento para zerar os airwires. Posso continuar com uma próxima etapa focada em orientar ou preparar o fechamento do layout.
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