Schaltplan Überprüfung und Korrektur
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Verstanden. Ich fasse dein Pin-/Block-Mapping zusammen und gleiche es mit deinem aktuellen Schaltplan ab, inkl. klarer Signalnamen für den PCB-Header.
A) Zentrale MCU: Teensy 4.1
- Versorgung: 3V3 verteilt an alle Peripherien, I/O ist 3.3 V-kompatibel.
- SD: BUILTIN_SDCARD, keine externe Buchse nötig.
B) Taster (Start/Stop)
- Schaltung: U1:33_ → Taster → GND
- Optional: 100 nF nach GND zum Entprellen. Falls gewünscht, kann ich einen 100nF Capacitor parallel zum Taster ergänzen.
C) IIS3DWB Kit über STEVAL-MKIGIBV2 Sockel, Interface SPI0
- Teensy Pins zu Netznamen:
- Pin 10 → ACC_CS
- Pin 11 → SPI_MOSI
- Pin 12 → SPI_MISO
- Pin 13 → SPI_SCK
- 3V3 → 3V3
- GND → GND
- Auf dem PCB: 2×12 Header für STEVAL-MKIGIBV2. Rausführen: 3V3, GND, SPI_SCK, SPI_MOSI (SDI), SPI_MISO (SDO), ACC_CS.
- Optional/Empfohlen: INT1, INT2 zusätzlich auf den Header legen:
D) OLED SSD1306 (I2C, 0x3C)
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Teensy Pins zu Netznamen:
- Pin 18 → I2C_SDA
- Pin 19 → I2C_SCL
- 3V3 → 3V3
- GND → GND
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PCB 4-Pin-Header (von links nach rechts empfohlen): GND – 3V3 – SDA – SCL
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Im Schaltplan korrigiert:
E) Grove GPS (Air530, Seeed 109020022), UART über Grove-Buchse
- Pins:
- GPS_TX (vom Modul) → Teensy RX2 Pin 7 → Net: GPS_RX_T4
- GPS_RX (zum Modul) → Teensy TX2 Pin 8 → Net: GPS_TX_T4
- VCC → bevorzugt 3V3
- GND → GND
- Grove-Header-Reihenfolge nach Seeed-Standard: GND – VCC – GPS_TX – GPS_RX. Ich kann die Buchse J3 so beschalten und die Netznamen setzen.
F) SD-Karte
- Keine externe SD-Buchse. Nur Teensy-intern, ok.
Offene Punkte zur Bestätigung:
- OLED-Versorgung: VCC auf 3V3 statt 5V umklemmen? Dann verbinde ich [U3:5V] mit 3V3.
- I2C-Pullups: Zielwert 4.7 kΩ für R1 und R2 bestätigen?
- STEVAL Header: Soll ich INT1/INT2 zusätzlich auf den 2×12 Header legen oder nur intern zum Teensy führen?
- Grove GPS VCC: 3V3 bestätigen, und Pin-Reihenfolge GND–VCC–GPS_TX–GPS_RX so festlegen?
Wenn du bestätigst, erstelle ich einen Ausführungsplan und setze die Änderungen direkt im Projekt um.
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