IMU-Bridge Integration Tools
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已按顺序检查
get_board_spec()、get_component_notes("icm20689")、get_design_rules()，并对照了当前原理图。先说结论：5 项里 4 项通过，1 项存在规则源冲突/部分不一致。
对照结果
Table
| 检查项 | KB 期望 | 当前原理图 | 结果 |
|---|---|---|---|
| 1. U2 / U3 的 REGOUT 电容 | REGOUT Pin 10 -> 0.47 µF X7R ±10%，板级约束明确指向 C9 / C10 | U2 REGOUT 接 REGOUT_U2，仅连 C9；C9 = 0.47 uF, X7R, ±10%。U3 REGOUT 接 REGOUT_U3，仅连 C10；C10 = 0.47 uF, X7R, ±10%。另一端都到 GND | ✅ |
| 2. nCS 是否直接接 VDD，无电容 | KB 要求 nCS 直接接 VDD/VCC_3V3，不加电容 | U2 nCS、U3 nCS 都直接在 VCC_3V3 网；未发现串接或并接电容 | ✅ |
| 3. NC 引脚是否悬空 | get_board_spec() 写的是 INT/CLKIN/AUX_DA/AUX_CL 悬空；但 get_component_notes() 的 datasheet 版规则是：INT 悬空、FSYNC 接 GND、其余 NC 焊盘悬空 | 当前原理图里 U2 / U3 的 INT 已加 NC 标记；FSYNC 实际接 GND；未见 CLKIN/AUX_DA/AUX_CL 作为独立命名引脚暴露在该符号中；其余命名为 NC 的焊盘未出现在已连接网络中 | ❌ / 部分不一致 |
| 4. I2C 上拉是否为 4.7 kΩ，主/子总线各一对 | 主总线一对、子总线一对，全部 4.7 kΩ | 主总线：R1 = 4.7 kΩ，MAIN_SCL -> VCC_3V3；R2 = 4.7 kΩ，MAIN_SDA -> VCC_3V3。子总线：R3 = 4.7 kΩ，SUB_SCL -> VCC_3V3；R4 = 4.7 kΩ，SUB_SDA -> VCC_3V3 | ✅ |
| 5. BOOT0 是否通过 10 kΩ 下拉 | BOOT0 -> 10 kΩ -> GND | U1 PA15/PA14-BOOT0 在 SWCLK_BOOT0 网上，接 R5 P1；R5 = 10 kΩ，P2 接 GND | ✅ |
Table
| 项目 | 说明 |
|---|---|
| nCS 引脚号 | 你给的检查项写的是 Pin 20，但当前器件符号里 U2 / U3 的 nCS 是 Pin 22。这一点和 get_component_notes() 的 datasheet 结果一致，但和早先 KB 某些摘要不一致。电气连接本身是正确的。 |
| NC 规则冲突 | 这里的唯一问题不是原理图明显接错，而是 KB 两个来源对“哪些脚应悬空”描述不完全一致：板级约束把 INT/CLKIN/AUX_DA/AUX_CL 归为悬空；datasheet 版器件知识则给出 INT 悬空、FSYNC 接 GND、其余 NC 焊盘悬空。当前原理图更符合 datasheet 版规则。 |
| 额外一致项 | C13 / C14 都是 2.2 uF 到 VDD；C15 / C16 都是 10 nF 到 VDDIO；这也和 get_component_notes() / get_design_rules() 一致。 |
- ✅ C9 / C10 的 REGOUT 实现正确
- ✅ U2 / U3 的 nCS 直接上拉到
VCC_3V3 - ✅ R1 - R4 的 I2C 上拉值与分配正确
- ✅ R5 的 BOOT0 下拉正确
- ❌ “NC 引脚悬空”这一项不能直接判为完全通过，因为 KB 规则文本自身有冲突；按 datasheet 口径看，当前原理图是合理的
我这次是按设计ator/网络做的实时结构化核对，这也是这类原理图审计的推荐方式
如果你要，我下一步可以继续把这份结果整理成一个**“规则冲突清单”**，明确指出：
- 哪些地方以
get_component_notes()为准 - 哪些地方
get_board_spec()需要修订。
Thought for 17 sec
get_component_notes("icm20689") 已成功返回。Table
| 项目 | 返回内容 |
|---|---|
| 重要警告 | 没有 CPOUT 引脚，任何 “CPOUT 电容” 描述都应忽略 |
| REGOUT | Pin 10 -> 0.47 µF X7R ±10% |
| VDD | Pin 9 -> 2.2 µF + 100 nF |
| VDDIO | Pin 8 -> 10 nF |
| nCS | Pin 22 -> 直接接 VDD，进入 I2C 模式，不加电容 |
| FSYNC | Pin 7 -> 接 GND，不可悬空 |
| I2C 地址 | AD0=GND -> 0x68；AD0=VDD -> 0x69 |
| WHO_AM_I | 0x98 |
| NC 引脚 | INT / CLKIN / AUX_DA / AUX_CL 悬空，严禁接 GND |
| 热焊盘 | 中央 EP 焊盘必须接 GND |
- FSYNC 不是 NC，必须接地
- nCS 是 Pin 22，不是 Pin 20，并且应直接接 VDD
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